设a=4’b1010,b=4’b0100,则按照Verilog HDL语法,(a>4’b1000)&(b==4’b0100）的运算结果是

设a=4’b1010,b=4’b0100,则按照Verilog HDL语法,(a>4’b1000)&(b==4’b0100）的运算结果是

分类：电子电路EDA技术
发表：2022年10月04日 00时10分38秒
作者： admin
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设a=4’b1010,b=4’b0100,则按照Verilog HDL语法,(a>4’b1000)&(b==4’b0100）的运算结果是

B.4’b0000
C.1
D.4’b1110

正确答案C

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